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2007.09.19

じわっと増えるVerilog/VHDL blog

コーヒーでも飲みながら検証の話でもから
有限?態機的都會傳奇(コピペできない)

たーぼ のハードウェア設計記録
VHDL TIPS 「shared variableの使用法」

あああ、素晴らしすぎる。
こういうHDLの小技を情報共有するってのは、半年前には全く無かった気がします。「各自好きな回路を作る。その過程で思ったことを書いておく」が今までのFPGA/HDL blogだとしたら、この2つはみんなで情報を共有しようという意志がある。

少しずつ良い世の中になっている。

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Comments

こんにちは。
いつもブログ拝見しています。

ブログの紹介、ありがとうございます。
変なタイトルにしたんでコピペできなかったようですね。
すみません。

こうやって反応してくれる人がいると嬉しいかぎりです。
マイペースですが、今後もコツコツ書いていきたいと思ってます。


Posted by: アイン | 2007.09.20 at 06:13 PM

いえいえ、こちらこそコメントありがとうございます。
エンコーディングの話は、もうちょっと複雑な回路で実験してみたいですね。

またネタがありましたら、よろしくお願いいたします。

Posted by: なつたん | 2007.09.21 at 06:43 PM

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